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  標(biāo)簽： verilog 編寫 分頻器

  上傳時間： 2016-01-23

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  標(biāo)簽： FPGA CPLD VHDL 分頻器

  上傳時間： 2013-12-15

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• 用verilog編寫適中分頻器 并且還有測試程序免費(fèi)下載

  資源簡介：用verilog編寫適中分頻器 并且還有測試程序

  標(biāo)簽： verilog 編寫 分頻器 測試程序

  上傳時間： 2013-11-28

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• 用verilog編寫適中分頻器 并且還有測試程序免費(fèi)下載

  資源簡介：用verilog編寫適中分頻器 并且還有測試程序

  標(biāo)簽： verilog 編寫 分頻器 測試程序

  上傳時間： 2013-12-17

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• verilog設(shè)計三分頻器代碼免費(fèi)下載

  資源簡介：用verilog編寫的三分頻器代碼，用modelsim測試沒有問題，有問題請反饋給我

  標(biāo)簽： verilog 三分頻 代碼

  上傳時間： 2017-02-26

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• 用verilog實(shí)現(xiàn)基于FPGA的通用分頻器免費(fèi)下載

  資源簡介：用verilog實(shí)現(xiàn)基于FPGA的通用分頻器

  標(biāo)簽： verilog FPGA 分頻器

  上傳時間： 2013-08-30

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• HT49 MCU的可編程分頻器(PFD)使用指南免費(fèi)下載

  資源簡介：HT49 MCU的可編程分頻器(PFD)使用指南 本文主要介紹 HT49 單片機(jī)可編程分頻器（PFD）的使用及注意事項(xiàng)。

  標(biāo)簽： MCU PFD HT 49

  上傳時間： 2013-11-03

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• 用VHDL編寫的8位全加器,數(shù)字分頻器等程序免費(fèi)下載

  資源簡介：用VHDL編寫的8位全加器,數(shù)字分頻器等程序

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  上傳時間： 2013-12-16

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• 利用VHDL語言編寫的一個16分頻器免費(fèi)下載

  資源簡介：利用VHDL語言編寫的一個16分頻器，另外可以在程序中修改為任意2N的分頻器

  標(biāo)簽： VHDL 語言 編寫 分頻器

  上傳時間： 2014-01-18

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• 用verilog實(shí)現(xiàn)基于FPGA的通用分頻器免費(fèi)下載

  資源簡介：用verilog實(shí)現(xiàn)基于FPGA的通用分頻器

  標(biāo)簽： verilog FPGA 分頻器

  上傳時間： 2015-08-20

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• 這是用VHDL 語言編寫的參數(shù)可以直接設(shè)置的2n倍時鐘分頻器免費(fèi)下載

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  標(biāo)簽： VHDL 語言 編寫 參數(shù)

  上傳時間： 2015-08-23

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  資源簡介：一個3分頻器。可進(jìn)一步改裝成實(shí)際需要的分頻器使用

  標(biāo)簽： 分頻器

  上傳時間： 2014-11-28

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• 《分頻器設(shè)計》絕對好用的EDA實(shí)驗(yàn)程序！已經(jīng)通過測試。VHDL語言編寫免費(fèi)下載

  資源簡介：《分頻器設(shè)計》絕對好用的EDA實(shí)驗(yàn)程序！已經(jīng)通過測試。VHDL語言編寫

  標(biāo)簽： VHDL EDA 分頻器 實(shí)驗(yàn)

  上傳時間： 2013-11-29

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• 基于FPGA的分頻器設(shè)計,已經(jīng)通過了仿真(VHDL語言編寫)免費(fèi)下載

  資源簡介：基于FPGA的分頻器設(shè)計,已經(jīng)通過了仿真(VHDL語言編寫)

  標(biāo)簽： FPGA VHDL 分頻器 仿真

  上傳時間： 2013-12-14

  上傳用戶：haoxiyizhong

• verilog分頻器～時鐘為50hmz免費(fèi)下載

  資源簡介：verilog分頻器～時鐘為50hmz，波特率采用9600bps～

  標(biāo)簽： verilog hmz 50 分頻器

  上傳時間： 2013-12-27

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• 任意整數(shù)分頻器的vhdl源程序,放心使用. 無版權(quán)問題,歡迎copy.免費(fèi)下載

  資源簡介：任意整數(shù)分頻器的vhdl源程序,放心使用. 無版權(quán)問題,歡迎copy.

  標(biāo)簽： vhdl copy 整數(shù) 分頻器

  上傳時間： 2016-01-28

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  資源簡介：基于fpga和sopc的用VHDL語言編寫的EDA數(shù)控分頻器

  標(biāo)簽： fpga VHDL sopc EDA

  上傳時間： 2014-01-03

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• vhdl語言編寫的2分頻器代碼免費(fèi)下載

  資源簡介：vhdl語言編寫的2分頻器代碼，簡單易懂

  標(biāo)簽： vhdl 語言 編寫 分頻器

  上傳時間： 2014-01-08

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• 分頻器是FPGA設(shè)計中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計中還廣泛使用集成鎖相環(huán)(如altera的PLL免費(fèi)下載

  資源簡介：分頻器是FPGA設(shè)計中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來進(jìn)行時鐘的分頻、倍頻以及相移設(shè)計，但是，對于時鐘要求不太嚴(yán)格的設(shè)計，通過自主設(shè)計進(jìn)行時鐘分頻的實(shí)現(xiàn)方法仍然非常流行。首先...

  標(biāo)簽： altera FPGA PLL 分頻器

  上傳時間： 2016-06-14

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• 該源碼為VHDL語言編寫的分頻器免費(fèi)下載

  資源簡介：該源碼為VHDL語言編寫的分頻器，在W-4b教學(xué)平臺上通過驗(yàn)證

  標(biāo)簽： VHDL 源碼 分頻器 語言

  上傳時間： 2016-09-17

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• 用verilog HDL實(shí)現(xiàn)的任意 頻率分頻器源代碼免費(fèi)下載

  資源簡介：用verilog HDL實(shí)現(xiàn)的任意 頻率分頻器源代碼，是一個通用的程序

  標(biāo)簽： verilog HDL 頻率 分頻器

  上傳時間： 2014-01-07

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• 這是我在ISP編程實(shí)驗(yàn)中獨(dú)立編寫的一個采用行為描述方式實(shí)現(xiàn)的分頻器免費(fèi)下載

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  標(biāo)簽： ISP 編程實(shí)驗(yàn) 獨(dú)立 方式

  上傳時間： 2017-01-19

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• 半整數(shù)分頻器的實(shí)現(xiàn)（verilog）免費(fèi)下載

  資源簡介：半整數(shù)分頻器的實(shí)現(xiàn)（verilog），本文以6.5分頻為例！很實(shí)用的！

  標(biāo)簽： verilog 整數(shù) 分頻器

  上傳時間： 2014-08-20

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• 標(biāo)簽： verilog 分頻器 N倍奇數(shù)分頻器.(verilog) N_odd_divider.v / verilog module N_odd_divider (免費(fèi)下載

  資源簡介：標(biāo)簽： verilog 分頻器 N倍奇數(shù)分頻器.(verilog) N_odd_divider.v / verilog module N_odd_divider (

  標(biāo)簽： verilog N_odd_divider module 分頻器

  上傳時間： 2014-01-12

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• verilog實(shí)現(xiàn)的奇數(shù)分頻器 針對任何規(guī)模的奇數(shù)分頻免費(fèi)下載

  資源簡介：verilog實(shí)現(xiàn)的奇數(shù)分頻器 針對任何規(guī)模的奇數(shù)分頻

  標(biāo)簽： verilog 分頻器 分頻 模

  上傳時間： 2017-06-19

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• 用verilog實(shí)現(xiàn)fpga的通用分頻器的實(shí)現(xiàn)免費(fèi)下載

  資源簡介：用verilog實(shí)現(xiàn)了奇數(shù)和偶數(shù)不同的分頻器設(shè)計

  標(biāo)簽： verilog fpga 分頻器

  上傳時間： 2016-07-11

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• 這是用VHDL語言寫的32位分頻器的程序免費(fèi)下載

  資源簡介：這是用VHDL語言寫的32位分頻器的程序，可直接運(yùn)行，看結(jié)果，歡迎使用。多指正，交流。

  標(biāo)簽： VHDL 語言 分頻器 程序

  上傳時間： 2015-05-11

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  標(biāo)簽： bcd 分頻器 計數(shù)電路

  上傳時間： 2014-01-14

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  資源簡介：基于VHDL語言描述的一個分頻器，根據(jù)端口值，可作為四分頻，八分頻等分頻器使用。

  標(biāo)簽： VHDL 語言 分頻器

  上傳時間： 2013-12-31

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• 分頻器免費(fèi)下載

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  標(biāo)簽： 分頻器

  上傳時間： 2016-09-18

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