相 關 資 源

• UART verilog TX/RX OpenCores share免費下載

  資源簡介：UART verilog TX/RX OpenCores share

  標簽： OpenCores verilog share UART

  上傳時間： 2014-12-04

  上傳用戶：er1219

• UART VHDL code : include tx,rx,parity bit control免費下載

  資源簡介：UART VHDL code : include tx,rx,parity bit control

  標簽： include control parity UART

  上傳時間： 2017-05-10

  上傳用戶：開懷常笑

• UART 0f ATMEGA 32 .basic tx rx.免費下載

  資源簡介：UART 0f ATMEGA 32 .basic tx rx.

  標簽： ATMEGA basic UART 0f

  上傳時間： 2017-07-03

  上傳用戶：ruixue198909

• LPC2131串口（TX+RX）+TIME0+ADC采樣的代碼,采用中斷方式編寫免費下載

  資源簡介：LPC2131串口（TX+RX）+TIME0+ADC采樣的代碼,采用中斷方式編寫，絕對經典！

  標簽： 2131 TIME LPC ADC

  上傳時間： 2015-05-07

  上傳用戶：sjyy1001

• UART verilog hdl 實現免費下載

  資源簡介：UART verilog hdl 實現

  標簽： verilog UART hdl

  上傳時間： 2014-01-11

  上傳用戶：PresidentHuang

• UART發送TX控制電路設計免費下載

  資源簡介：UART發送TX控制電路設計，以波特率產生器的EnableTX將數據DATAO以LOAD信號將其送入發送緩沖器Tbuff，并令寄存器內容已載有數據而非空出的標志tmpTBufE=0。當同步波特率信號來臨時監視是否處于tmpTBufE=0（內有數據）以及tmpTRegE=1（沒有數據）。即處于尚未啟...

  標簽： UART 發送 控制 電路設計

  上傳時間： 2016-06-23

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• UART verilog 代碼 可綜合 很好的代碼免費下載

  資源簡介：UART verilog 代碼 可綜合 很好的代碼

  標簽： verilog UART 代碼

  上傳時間： 2017-03-11

  上傳用戶：a6697238

• test w5300 Tx/Rx memory免費下載

  資源簡介：test w5300 Tx/Rx memory

  標簽： memory w5300 test Tx

  上傳時間： 2014-01-11

  上傳用戶：wangdean1101

• Arduino控制器使用圖文教程免費下載

  資源簡介：? Arduino 是一塊基于開放原始代碼的Simple i/o 平臺，并且具有使用類似java,C 語言的開發環境。讓您可以快速 使用Arduino 語言與Flash 或Processing…等軟件，作出互動作品。Arduino 可以使用開發完成的電子元件例如Switch 或Sensors 或其他控制器、ＬＥＤ...

  標簽： Arduino 控制器 圖文教程

  上傳時間： 2014-01-14

  上傳用戶：909000580

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  標簽： Arduino 控制器 圖文教程

  上傳時間： 2013-10-30

  上傳用戶：wangzhen1990

• A system simulation environment in Matlab/Simulink of RFID is constructed in this paper. Special at免費下載

  資源簡介：A system simulation environment in Matlab/Simulink of RFID is constructed in this paper. Special attention is emphasized on the analog/RF circuit.Negative effects are concerned in the system model,such as phase noise of the local oscillat...

  標簽： environment constructed simulation Simulink

  上傳時間： 2014-01-09

  上傳用戶：zhangliming420

• 基于OFDM的無線寬帶系統仿真It contains mainly two parts, i.e. link-level simulator and system-level simulator. 免費下載

  資源簡介：基于OFDM的無線寬帶系統仿真It contains mainly two parts, i.e. link-level simulator and system-level simulator. Link-level simulator focus on a single-cell single-user scenario, where signal is transmitted from tx, and estimated at rx. Com...

  標簽： simulator i.e. system-level link-level

  上傳時間： 2016-03-15

  上傳用戶：xsnjzljj

• 在c++builder環境下一個串口通信程序免費下載

  資源簡介：在c++builder環境下一個串口通信程序，包括界面的設計和串口通信函數的設計，實現了串口通信。在文件夾TX-RX中。

  標簽： builder 環境 串口通信 程序

  上傳時間： 2013-12-10

  上傳用戶：ippler8

• 一個UWB仿真程序包免費下載

  資源簡介：一個UWB仿真程序包，里面包含信號生成，信道模擬，Tx/Rx等模塊。M-file

  標簽： UWB 仿真程序

  上傳時間： 2016-05-22

  上傳用戶：xiaoxiang

• RON1328SX1278帶PA無線模塊免費下載

  資源簡介：1.1 模組說明RON132系8 列無線模組是基于 SEMTEC開H發的一款遠程大容量網絡系統解決方案 SX1278開發的，除傳統的GFSK調制技術外，新型的SX127x平臺還采用了LoRa（遠程）擴頻技術。該模塊具有高效的接收靈敏度和超強的抗干擾性能。該系列模組可以非常容易地嵌...

  標簽： 無線模塊

  上傳時間： 2022-06-19

  上傳用戶：xsr1983

• verilog code which receive from UART RX and then output to lcd text display.免費下載

  資源簡介：verilog code which receive from UART RX and then output to lcd text display.

  標簽： verilog receive display output

  上傳時間： 2016-03-07

  上傳用戶：songrui

• FPGA的UART控制器的verilog源程序免費下載

  資源簡介：FPGA的UART控制器的verilog源程序，在cyclone II EP2C8Q208上調試運行成功

  標簽： verilog FPGA UART 控制器

  上傳時間： 2013-08-15

  上傳用戶：qazxsw

• 包含UART口的verilog源程序免費下載

  資源簡介：包含UART口的verilog源程序，該程序在FPGA上驗證通過，可作為芯片設計，或FPGA設計的一個完整IP核，硬件設計的兄弟們可參考一下。

  標簽： verilog UART 源程序

  上傳時間： 2015-03-14

  上傳用戶：VRMMO

• 硬件UART源程序verilog HDL免費下載

  資源簡介：硬件UART源程序verilog HDL，即相關文檔

  標簽： verilog UART HDL 硬件

  上傳時間： 2015-04-25

  上傳用戶：pompey

• UART d的verilog 程序免費下載

  資源簡介：UART d的verilog 程序，可以實現普通串口功能

  標簽： verilog UART 程序

  上傳時間： 2013-12-29

  上傳用戶：lhc9102

• Models UWB TX and RX using BPSK fifth derivative. MATLAB Release: R13 Description: This m file免費下載

  資源簡介：Models UWB TX and RX using BPSK fifth derivative. MATLAB Release: R13 Description: This m file models a UWB system using BPSK with the fifth order derivative of the gaussian pulse with correlation receiver and intgrator.

  標簽： Description derivative Release Models

  上傳時間： 2015-05-08

  上傳用戶：zhliu007

• verilog 編程 有測試文檔 基于查表結構實現 離散余弦變換dct 來源：OpenCores免費下載

  資源簡介：verilog 編程 有測試文檔 基于查表結構實現 離散余弦變換dct 來源：OpenCores

  標簽： OpenCores verilog dct 編程

  上傳時間： 2013-12-09

  上傳用戶：aig85

• FPGA/CPLD應用,UART的verilog HDL原碼免費下載

  資源簡介：FPGA/CPLD應用,UART的verilog HDL原碼

  標簽： verilog FPGA CPLD UART

  上傳時間： 2013-12-28

  上傳用戶：lizhizheng88

• This verilog HDL description implements a UART.免費下載

  資源簡介：This verilog HDL description implements a UART.

  標簽： description implements verilog This

  上傳時間： 2013-12-17

  上傳用戶：wff

• mentor UART IP verilog源碼 以通過驗證.免費下載

  資源簡介：mentor UART IP verilog源碼 以通過驗證.

  標簽： verilog mentor UART IP

  上傳時間： 2014-07-10

  上傳用戶：dyctj

• MATLAB仿真uwb使用bpsk調制解調的發送(TX)和接收(RX)免費下載

  資源簡介：MATLAB仿真uwb使用bpsk調制解調的發送(TX)和接收(RX)

  標簽： MATLAB bpsk uwb TX

  上傳時間： 2015-09-30

  上傳用戶：yoleeson

• rf tx coding for TX and RX免費下載

  資源簡介：rf tx coding for TX and RX

  標簽： coding and for rf

  上傳時間： 2015-11-09

  上傳用戶：daoxiang126

• UART串行口,用verilog編寫的.供大家參考免費下載

  資源簡介：UART串行口,用verilog編寫的.供大家參考

  標簽： verilog UART 串行口 編寫

  上傳時間： 2013-12-15

  上傳用戶：417313137

• 占用資源少的verilog HDL UART接口；采用固定波特率115200免費下載

  資源簡介：占用資源少的verilog HDL UART接口；采用固定波特率115200，可以修改程序中的分頻來修改波特率，模式為1個啟始位，8位數據位，1個停止位；帶1字節緩存；當緩存空時輸出空信號

  標簽： verilog 115200 UART HDL

  上傳時間： 2013-12-28

  上傳用戶：kikye

• 自己編寫的串口UART發送的verilog模塊。與FIFO連接免費下載

  資源簡介：自己編寫的串口UART發送的verilog模塊。與FIFO連接，可以實現自動連續發送。

  標簽： verilog UART FIFO 編寫

  上傳時間： 2013-12-28

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