相 關 資 源

• or1200開源risc cpu的verilog描述實現免費下載

  資源簡介：or1200開源risc cpu的verilog描述實現，cpu源代碼分析與芯片設計一書的源碼

  標簽： verilog 1200 risc cpu

  上傳時間： 2017-02-28

  上傳用戶：litianchu

• risc cpu的verilogHDL描述免費下載

  資源簡介：risc cpu的verilogHDL描述

  標簽： verilogHDL risc cpu

  上傳時間： 2015-04-08

  上傳用戶：csgcd001

• 一個嵌入式risc cpu 的verilog 設計源碼免費下載

  資源簡介：一個嵌入式risc cpu 的verilog 設計源碼，可綜合。內含詳細的設計文擋。

  標簽： verilog risc cpu 嵌入式

  上傳時間： 2015-04-16

  上傳用戶：tianjinfan

• 這是一個verilog HDL編寫的risc cpu的程序免費下載

  資源簡介：這是一個verilog HDL編寫的risc cpu的程序，該程序共10個子程序，實現了簡單的risc cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。

  標簽： verilog risc HDL cpu

  上傳時間： 2015-03-26

  上傳用戶：qiao8960

• 8位risc　cpu的verilog編程　SOURCECODE免費下載

  資源簡介：8位risc　cpu的verilog編程　SOURCECODE

  標簽： SOURCECODE verilog risc cpu

  上傳時間： 2015-01-09

  上傳用戶：Andy123456

• 流水線cpu的verilog代碼.rar免費下載

  資源簡介：一種流水線cpu的verilog源代碼，里面有各個模塊的源代碼，希望對大家有幫助

  標簽： verilog cpu 流水線

  上傳時間： 2013-07-14

  上傳用戶：xymbian

• 幾個VHDL的源代碼和和一個本人編寫的5級流水線risc cpu的代碼免費下載

  資源簡介：幾個VHDL的源代碼和和一個本人編寫的5級流水線risc cpu的代碼

  標簽： VHDL risc cpu 源代碼

  上傳時間： 2013-12-02

  上傳用戶：jyycc

• AES高級加密算法的verilog語言實現。同時附有AES協議的pdf文檔免費下載

  資源簡介：AES高級加密算法的verilog語言實現。同時附有AES協議的pdf文檔，和此代碼的測試程序，可作為一個IP核直接使用，可減少開發人員的設計時間。

  標簽： AES verilog 加密算法

  上傳時間： 2014-01-08

  上傳用戶：PresidentHuang

• 一個關于DES算法的verilog語言實現,包括了各個實現模塊以及測試模塊免費下載

  資源簡介：一個關于DES算法的verilog語言實現,包括了各個實現模塊以及測試模塊

  標簽： verilog DES 算法 模塊

  上傳時間： 2014-01-23

  上傳用戶：璇珠官人

• 1024點８位FFT的verilog語言實現免費下載

  資源簡介：1024點８位FFT的verilog語言實現

  標簽： verilog 1024 FFT 語言

  上傳時間： 2015-06-09

  上傳用戶：ztj182002

• 8BIT MCU 的verilog代碼實現免費下載

  資源簡介：8BIT MCU 的verilog代碼實現，具有一定的參考價值

  標簽： verilog 8BIT MCU 代碼

  上傳時間： 2015-09-20

  上傳用戶：hasan2015

• aes算法的verilog hdl實現免費下載

  資源簡介：aes算法的verilog hdl實現，供給大家作為參考 。

  標簽： verilog aes hdl 算法

  上傳時間： 2013-12-18

  上傳用戶：gundan

• 16位risc cpu的ALU免費下載

  資源簡介：16位risc cpu的ALU，使用VHDL編寫

  標簽： risc cpu ALU

  上傳時間： 2016-05-10

  上傳用戶：czl10052678

• can控制器的verilog語言實現 （還要更多的說明語言了嗎？我不知道該寫什么了）免費下載

  資源簡介：can控制器的verilog語言實現 （還要更多的說明語言了嗎？我不知道該寫什么了）

  標簽： verilog can 語言 控制器

  上傳時間： 2014-01-04

  上傳用戶：Breathe0125

• 213viterbi譯碼的verilog語言實現免費下載

  資源簡介：213viterbi譯碼的verilog語言實現

  標簽： viterbi verilog 213 譯碼

  上傳時間： 2016-08-10

  上傳用戶：nanfeicui

• 8位risc cpu的編寫免費下載

  資源簡介：8位risc cpu的編寫，使用quartus軟件對其進行寫入，里面內置乘法器、除法器等模塊

  標簽： risc cpu 8位 編寫

  上傳時間： 2016-08-13

  上傳用戶：cc1915

• 32 risc cpu的參考設計免費下載

  資源簡介：32 risc cpu的參考設計，內涵完整的testbench

  標簽： risc cpu 32 參考設計

  上傳時間： 2017-01-14

  上傳用戶：520

• cpu的vhdl設計實現加法減法乘法運算免費下載

  資源簡介：cpu的vhdl設計實現加法減法乘法運算

  標簽： vhdl cpu 設計實現 加法減法

  上傳時間： 2017-02-01

  上傳用戶：924484786

• I2C總線的verilog語言實現免費下載

  資源簡介：I2C總線的verilog語言實現，稍經修改即可應用于實際工程

  標簽： verilog I2C 總線 語言

  上傳時間： 2013-12-24

  上傳用戶：miaochun888

• 8051內核的verilog描述免費下載

  資源簡介：8051內核的verilog描述，對學習EDA和處理器設計很有用的資料。

  標簽： verilog 8051 內核

  上傳時間： 2017-04-02

  上傳用戶：Yukiseop

• FIFO的verilog描述免費下載

  資源簡介：FIFO的verilog描述

  標簽： verilog FIFO

  上傳時間： 2013-12-01

  上傳用戶：llandlu

• 這是我同學在上海交大實習的時候做的一個單片機的verilog代碼實現免費下載

  資源簡介：這是我同學在上海交大實習的時候做的一個單片機的verilog代碼實現，希望對大家有幫助

  標簽： verilog 海 實習 單片機

  上傳時間： 2014-01-05

  上傳用戶：aa17807091

• 運行在FPGA上的verilog程序(實現對ADC的控制)...免費下載

  資源簡介：運行在FPGA上的verilog程序(實現對ADC的控制)...

  標簽： verilog FPGA ADC 運行

  上傳時間： 2013-12-28

  上傳用戶：wyc199288

• 基于FPGA的八位risc cpu的設計....免費下載

  資源簡介：基于FPGA的八位risc cpu的設計....

  標簽： FPGA risc cpu

  上傳時間： 2017-06-24

  上傳用戶：JIUSHICHEN

• RAm的 verilog描述免費下載

  資源簡介：RAm的 verilog描述，在Quartus中驗證正確，可根據程序改成其他參數

  標簽： verilog RAm

  上傳時間： 2014-01-21

  上傳用戶：litianchu

• 位加法器的verilog程序與4×4 乘法器的verilog描述！！！免費下載

  資源簡介：位加法器的verilog程序與4×4 乘法器的verilog描述！！！

  標簽： verilog 加法器 乘法器 程序

  上傳時間： 2013-12-21

  上傳用戶：ruixue198909

• 雙口RAM的verilog描述 雙口RAM的verilog描述免費下載

  資源簡介：雙口RAM的verilog描述 雙口RAM的verilog描述

  標簽： verilog RAM 雙口

  上傳時間： 2013-12-23

  上傳用戶：xg262122

• spi 通信的master部分使用的verilog語言實現免費下載

  資源簡介：spi 通信的master部分使用的verilog語言實現，可以做為你的設計參考。module spi_master(rstb,clk,mlb,start,tdat,cdiv,din, ss,sck,dout,done,rdata);? ? input rstb,clk,mlb,start;? ? input [7:0] tdat;? //transmit data? ? input [1:0] cdiv;? /...

  標簽： spi 通信 master verilog

  上傳時間： 2022-02-03

  上傳用戶：

• VxWorks中主備數據一致性功能組件的設計與實現.pdf ：數據一致性是主備用系統必須解決的問題。目前主備 系統的一致性都采用手工編程來實現。導致代碼結構繁雜免費下載

  資源簡介：VxWorks中主備數據一致性功能組件的設計與實現.pdf ：數據一致性是主備用系統必須解決的問題。目前主備 系統的一致性都采用手工編程來實現。導致代碼結構繁雜， 且效率不高。利用VxWorks的異常處理機制，結合risc cpu 的特性．設計實現了一個數據一致性功...

  標簽： VxWorks 數據

  上傳時間： 2014-01-21

  上傳用戶：ddddddos

• verilog-risc cpu 代碼 實現了簡單的risc cpu免費下載

  資源簡介：verilog-risc cpu 代碼 實現了簡單的risc cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。 北航

  標簽： verilog-risc risc cpu cpu

  上傳時間： 2016-12-25

  上傳用戶：han_zh