fpga時鐘,vhdl,帶設置時分秒,暫停,復位功能
資源簡介:fpga時鐘分析,包括門控時鐘與時鐘偏儀分析,邏輯設計時鐘分析,毛刺分析.
上傳時間: 2013-08-30
上傳用戶:432234
資源簡介:fpga時鐘分析,包括門控時鐘與時鐘偏儀分析,邏輯設計時鐘分析,毛刺分析.
上傳時間: 2015-10-14
上傳用戶:lps11188
資源簡介:fpga時鐘設計程序代碼,可調整時間,六位顯示。
上傳時間: 2015-12-23
上傳用戶:稀世之寶039
資源簡介:EP2C CYCONLY 系列的fpga時鐘測試程序,是由內部時鐘分頻后,點亮數碼顯示燈來證明的。絕對好用的程序。編寫的執行效率很高
上傳時間: 2014-01-13
上傳用戶:leehom61
資源簡介:首先介紹了采用直接數字頻率合成(DDS)技術的正弦信號發生器的基本原理和采用fpga實現DDS信號發生器的基本方法,然后結合DDS的原理分析了采用DDS方法實現的正弦信號發生器的優缺點,其中重點分析了幅度量化雜散產生的誤差及其原因,最后針對DDS原理上存在的...
上傳時間: 2013-10-09
上傳用戶:ssj927211
資源簡介:首先介紹了采用直接數字頻率合成(DDS)技術的正弦信號發生器的基本原理和采用fpga實現DDS信號發生器的基本方法,然后結合DDS的原理分析了采用DDS方法實現的正弦信號發生器的優缺點,其中重點分析了幅度量化雜散產生的誤差及其原因,最后針對DDS原理上存在的...
上傳時間: 2013-11-21
上傳用戶:himbly
資源簡介:本書系統講解通信網絡領域Xilinx fpga內部的IP硬核。以流行的Xilinx Virtex-6型號芯片舉例,涵蓋Xilinx fpga在通信領域主流的IP核,闡述Xilinx fpga時鐘資源和DCM、PLL和MMCM時鐘管理器的特性和使用方法;介紹基于Block RAM資源生成ROM、RAM、FIFO和CAM核...
上傳時間: 2022-06-11
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資源簡介:DSP的使用正呈爆炸式發展。OFDM、GPS相關器、FFT、FIR濾波器或H.264之類計算密集型算法在從移動電話到汽車的各種應用中都很常見。設計人員實現DSP有三種選擇:他們可以使用DSP處理器、fpga或掩膜ASIC。ASIC具有最高的吞吐量、最低的功耗和最低的成本,但其極...
上傳時間: 2013-10-29
上傳用戶:xymbian
資源簡介:影響fpga設計中時鐘因素的探討,能幫組fpga的設計
上傳時間: 2013-08-05
上傳用戶:wkxiian
資源簡介:基于fpga和PLL的函數信號發生器時鐘部分的實現
上傳時間: 2013-08-08
上傳用戶:xzt
資源簡介:大型設計中fpga的多時鐘設計策略,希望有需要的人喜歡
上傳時間: 2013-08-14
上傳用戶:zhichenglu
資源簡介:fpga異步時鐘設計中的同步策略,需要
上傳時間: 2013-08-23
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資源簡介:通過fpga產生時鐘的VHDL源碼,QII7.1下調試通過
上傳時間: 2013-08-24
上傳用戶:wtrl
資源簡介:基于fpga的新型數據位同步時鐘提取(CDR)實現方法
上傳時間: 2013-08-28
上傳用戶:huyahui
資源簡介:fpga的時鐘詳細講解,可以讓你更加熟悉的了解fpga的時鐘設計。
上傳時間: 2013-08-29
上傳用戶:1101055045
資源簡介:CPLD/fpga設計中的時鐘應用講解 及其實例
上傳時間: 2013-09-01
上傳用戶:3到15
資源簡介:大型設計中fpga的多時鐘設計策略,很詳細的描述了在fpga設計中時鐘設計的方法
上傳時間: 2013-09-04
上傳用戶:妄想演繹師
資源簡介:無淪是用離散邏輯、可編程邏輯,還是用全定制硅器件實現的任何數字設計,為了成功地操\r\n作,可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導致錯誤的行為,并且調試困難、花銷很大。 在設計PLD/fpga時通常采用幾...
上傳時間: 2013-09-04
上傳用戶:yelong0614
資源簡介:fpga全局時鐘約束(Xilinx)
上傳時間: 2013-11-13
上傳用戶:農藥鋒6
資源簡介:提出了一種基于fpga的時鐘跟蹤環路的設計方案,該方案簡化了時鐘跟蹤環路的結構,降低了時鐘調整電路的復雜度。實際電路測試結果表明,該方案能夠使接收機時鐘快速準確地跟蹤發射機時鐘的變化,且時鐘抖動小、穩準度高、工作穩定可靠。
上傳時間: 2014-12-28
上傳用戶:498732662
資源簡介:目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一般在fpga設計中采用全局時鐘資源驅動設計的主時鐘,以達到最低的時鐘抖動和延遲。 fpga全局時...
上傳時間: 2014-01-01
上傳用戶:maqianfeng
資源簡介:隨著電子技術的快速發展,各種電子設備對時間精度的要求日益提升。在衛星發射、導航、導彈控制、潛艇定位、各種觀測、通信等方面,時鐘同步技術都發揮著極其重要的作用,得到了廣泛的推廣。對于分布式采集系統來說,中心主站需要對來自于不同采集設備的采集數...
上傳時間: 2013-08-05
上傳用戶:lz4v4
資源簡介:在工業控制領域,多種現場總線標準共存的局面從客觀上促進了工業以太網技術的迅速發展,國際上已經出現了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業以太網協議。將傳統的商用以太網應用于工業控制系統的現場設備層...
上傳時間: 2013-08-04
上傳用戶:hn891122
資源簡介:fpga器件在通信、消費類電子等領域應用越來越廣泛,隨著fpga規模的增大、功能的加強對時鐘的要求也越來越高。在fpga中嵌入時鐘發生器對解決該問題是一個不錯的選擇。本論文首先,描述并分析了電荷泵鎖相環時鐘發生器的體系結構、組成單元及各單元的非理想特性...
上傳時間: 2013-04-24
上傳用戶:變形金剛
資源簡介:在工業控制領域,多種現場總線標準共存的局面從客觀上促進了工業以太網技術的迅速發展,國際上已經出現了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業以太網協議。將傳統的商用以太網應用于工業控制系統的現場設備層...
上傳時間: 2013-07-28
上傳用戶:heart520beat
資源簡介:fpga芯片與ADI公司的AD9779之間的通信,總共有四個通道,68對LVDS,采樣時鐘是122.88MHz
上傳時間: 2013-08-10
上傳用戶:一天睡三次
資源簡介:一種基于fpga 實現的全并行結構FFT 設計方法,采用全并行加流水結構, 可在一個時鐘節拍內完成32 點FFT 運算的功能, 設計最高運算速度可達11ns
上傳時間: 2013-08-16
上傳用戶:467368609
資源簡介:用fpga實現大型設計時,可能需要fpga具有以多個時鐘運行的多重數據通路,這種多時鐘fpga設計必須特別小心,需要注意最大時鐘速率、抖動、最大時鐘數、異步時鐘設計和時鐘/數據關系。設計過程中最重要的一步是確定要用多少個不同的時鐘,以及如何進行布線
上傳時間: 2013-08-23
上傳用戶:q986086481
資源簡介:1、 利用FLEX10的片內RAM資源,根據DDS原理,設計產生正弦信號的各功能模塊和頂層原理圖; 2、 利用實驗板上的TLC7259轉換器,將1中得到的正弦信號,通過D/A轉換,通過ME5534濾波后在示波器上觀察; 3、 輸出波形要求: 在輸入時鐘頻率為16KHz時,輸出正弦波...
上傳時間: 2013-09-06
上傳用戶:zhuimenghuadie
資源簡介:簡單明了的VHDL程序實現24小時計時時鐘!
上傳時間: 2013-10-19
上傳用戶:ikemada