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  資源簡介：fredivn.vhd 偶數分頻\r\nfredivn1.vhd 奇數分頻\r\nfrediv16.vhd 16分頻\r\nPULSE.vhd 數控分頻器

  標簽： FPGA 分頻器 源代碼

  上傳時間： 2013-08-15

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• 基于CPLD-FPGA的半整數分頻器的設計免費下載

  資源簡介：基于CPLD-FPGA的半整數分頻器的設計，用于設計EDA

  標簽： CPLD-FPGA 整數 分頻器

  上傳時間： 2013-09-03

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• 用VerilogHDL實現基于FPGA的通用分頻器的設計免費下載

  資源簡介：用VerilogHDL實現基于FPGA的通用分頻器的設計

  標簽： VerilogHDL FPGA 分頻器

  上傳時間： 2013-10-28

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• 用VerilogHDL實現基于FPGA的通用分頻器的設計免費下載

  資源簡介：用VerilogHDL實現基于FPGA的通用分頻器的設計

  標簽： VerilogHDL FPGA 分頻器

  上傳時間： 2015-01-02

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• 基于CPLD-FPGA的半整數分頻器的設計免費下載

  資源簡介：基于CPLD-FPGA的半整數分頻器的設計，用于設計EDA

  標簽： CPLD-FPGA 整數 分頻器

  上傳時間： 2015-04-09

  上傳用戶：凌云御清風

• 第7章數字系統設計實例 7.1 半整數分頻器的設計 7.2 音樂發生器 7.3 2FSK/2PSK信號產生器 7.4 實用多功能電子表 7.5 交通燈控制器 7.6 數字頻率計免費下載

  資源簡介：第7章數字系統設計實例 7.1 半整數分頻器的設計 7.2 音樂發生器 7.3 2FSK/2PSK信號產生器 7.4 實用多功能電子表 7.5 交通燈控制器 7.6 數字頻率計

  標簽： 7.1 7.2 7.3 FSK

  上傳時間： 2015-06-23

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• 一個基于CPLD/FPGA的半整數分頻器的設計的文檔資料免費下載

  資源簡介：一個基于CPLD/FPGA的半整數分頻器的設計的文檔資料

  標簽： CPLD FPGA 整數 分頻器

  上傳時間： 2016-07-13

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• 利用計數器和分頻器設計一個實時的時鐘。一共需要1個模24計數器、2個模6計數器、2個模10計數器、一個生成1Hz的分頻器和6個數碼管解碼器。最終用HEX5~HEX4顯示小時（0~23）免費下載

  資源簡介：利用計數器和分頻器設計一個實時的時鐘。一共需要1個模24計數器、2個模6計數器、2個模10計數器、一個生成1Hz的分頻器和6個數碼管解碼器。最終用HEX5~HEX4顯示小時（0~23），用HEX3~HEX2顯示分鐘（0~59），用HEX1~HEX0顯示秒鐘（0~59）。

  標簽： HEX 計數器 模 1Hz

  上傳時間： 2014-12-20

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• 基于FPGA的分頻器的設計與實現免費下載

  資源簡介：該文檔為基于FPGA的分頻器的設計與實現簡介文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

  標簽： FPGA

  上傳時間： 2021-11-15

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  資源簡介：該文檔為FPGA_ASIC-基于CPLD、FPGA的半整數分頻器的設計講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

  標簽： FPGA cpld

  上傳時間： 2022-02-26

  上傳用戶：slq1234567890

• 本文介紹了兩種分頻系數為整數或半整數的可控分頻器的設計方法。其中之一可以實現50％的奇數分頻。利用VHDL語言編程免費下載

  資源簡介：本文介紹了兩種分頻系數為整數或半整數的可控分頻器的設計方法。其中之一可以實現50％的奇數分頻。利用VHDL語言編程，并用QUARTERS||4.0進行仿真，用 FPGA 芯片實現。 關鍵詞：半整數，可控分頻器，VHDL, FPGA

  標簽： VHDL 分頻 整數 系數

  上傳時間： 2015-11-27

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• 帶分頻器的bcd計數電路設計免費下載

  資源簡介：帶分頻器的bcd計數電路設計，verilog源碼

  標簽： bcd 分頻器 計數電路

  上傳時間： 2014-01-14

  上傳用戶：s363994250

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  資源簡介：本文件介紹的是用VerilogHDL語言設計分頻器和32位計數器.

  標簽： VerilogHDL 語言 分頻器 計數器

  上傳時間： 2013-12-15

  上傳用戶：縹緲

• 本文主要介紹了50％占空比三分頻器的三種設計方法免費下載

  資源簡介：本文主要介紹了50％占空比三分頻器的三種設計方法，并給出了圖形設計、VHDL設計、編譯結果和仿真結果。設計中采用EPM7064AETC44-7 CPLD，在QUARTUSⅡ4.2軟件平臺上進行。

  標簽： 三分頻 設計方法

  上傳時間： 2014-01-25

  上傳用戶：凌云御清風

• 數控分頻器的設計數控分頻器的功能就是當在輸入端給定不同輸入數據時免費下載

  資源簡介：數控分頻器的設計數控分頻器的功能就是當在輸入端給定不同輸入數據時，將對輸入的時鐘信號有不同的分頻比，數控分頻器就是用計數值可并行預置的加法計數器設計完成的，方法是將計數溢出位與預置數加載輸入信號相接即可。

  標簽： 數控 分頻器 數據 輸入端

  上傳時間： 2016-10-13

  上傳用戶：wangzhen1990

• 數控分頻器的設計 數控分頻器的功能就是當在輸入端給定不同輸入數據時免費下載

  資源簡介：數控分頻器的設計 數控分頻器的功能就是當在輸入端給定不同輸入數據時，將對輸入的時鐘信號有不同的分頻比，例3的數控分頻器就是用計數值可并行預置的加法計數器設計完成的，方法是將計數溢出位與預置數加載輸入信號相接即可。

  標簽： 數控 分頻器 數據 輸入端

  上傳時間： 2013-12-11

  上傳用戶：黑漆漆

• 半整數分頻器的設計 請不要上傳有版權爭議的內容和木馬病毒代碼免費下載

  資源簡介：半整數分頻器的設計 請不要上傳有版權爭議的內容和木馬病毒代碼

  標簽： 整數 分頻器 代碼 木馬

  上傳時間： 2014-08-16

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• 介紹了各種分頻器的設計免費下載

  資源簡介：介紹了各種分頻器的設計，VHDL描述。包括偶數分頻器，奇數分頻器，辦整數分頻器

  標簽： 分頻器

  上傳時間： 2017-05-18

  上傳用戶：haohaoxuexi

• 數控分頻器的輸出信號頻率為輸入數據的函數。用傳統的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差?；赩HDL 的數控分頻器設計,整個過程簡單、快捷,極易修改,可移植性免費下載

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  標簽： VHDL 數控 分頻器 修改

  上傳時間： 2014-11-29

  上傳用戶：1051290259

• 利用FPGA進行分頻期的設計免費下載

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  標簽： FPGA 分頻

  上傳時間： 2017-07-17

  上傳用戶：lhc9102

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  資源簡介：基于Quartus II的數控分頻器的項目設計，實現對時鐘信號的任意進制分頻，包含了項目文件和VHDL源代碼

  標簽： Quartus 數控 分頻器 項目設計

  上傳時間： 2017-07-18

  上傳用戶：yangbo69

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  資源簡介：基于VDHL的38譯碼器的實現與58分頻器的實現 FPGA主芯片：CycloneII EP2C35F672C6

  標簽： CycloneII VDHL FPGA 672C

  上傳時間： 2014-01-17

  上傳用戶：banyou

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  標簽： FPGA

  上傳時間： 2021-12-01

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  資源簡介：自己編的一個分頻器的程序模版 雖然原理很簡單，經過多次實踐很實用 被多次用在其它的程序中

  標簽： 分頻器 程序 模版

  上傳時間： 2015-03-20

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  資源簡介：這是用VHDL語言寫的32位分頻器的程序，可直接運行，看結果，歡迎使用。多指正，交流。

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  上傳時間： 2015-05-11

  上傳用戶：chenlong

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  標簽： VHDL N進制 分頻器 代碼

  上傳時間： 2013-12-25

  上傳用戶：洛木卓

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  資源簡介：常用2、4、6及任意偶數分頻器的VHDL代碼實現（原創）

  標簽： VHDL 分頻器 代碼

  上傳時間： 2013-12-17

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  資源簡介：常用1、3、5及任意奇數分頻器的VHDL代碼實現（原創）

  標簽： VHDL 分頻器 代碼

  上傳時間： 2013-12-26

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  資源簡介：關于用觸發器構建簡單分頻器的介紹文檔，圖文并茂，講解詳細

  標簽： 觸發器 分頻器 文檔

  上傳時間： 2015-09-27

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  資源簡介：任意整數分頻器的vhdl源程序,放心使用. 無版權問題,歡迎copy.

  標簽： vhdl copy 整數 分頻器

  上傳時間： 2016-01-28

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