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  標簽： 4040 CMOS 二進制計 分頻器

  上傳時間： 2013-05-15

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  標簽： cd40 cd45 datasheet

  上傳時間： 2021-11-09

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  上傳時間： 2014-01-14

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  上傳時間： 2013-12-17

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  標簽： VHDL 分頻器 代碼

  上傳時間： 2013-12-26

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  標簽： 8位 加法器 分頻電路

  上傳時間： 2013-12-23

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  標簽： VHDL EDA 函數(shù) 交通燈

  上傳時間： 2013-12-23

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  標簽： HEX 計數(shù)器 模 1Hz

  上傳時間： 2014-12-20

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  標簽： vhdl 語言 分頻器

  上傳時間： 2013-12-30

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  資源簡介：計數(shù),定時器應用.撥碼開關一次只選一個..393作分頻器用

  標簽： 393 定時器 分頻器 撥碼開關

  上傳時間： 2014-01-07

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  標簽： altera FPGA PLL 分頻器

  上傳時間： 2016-06-14

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  標簽： FPGA CPLD VHDL 分頻器

  上傳時間： 2013-12-15

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• 數(shù)控分頻器的設計 數(shù)控分頻器的功能就是當在輸入端給定不同輸入數(shù)據(jù)時免費下載

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  標簽： 數(shù)控 分頻器 數(shù)據(jù) 輸入端

  上傳時間： 2013-12-11

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  資源簡介：數(shù)控分頻器的輸出信號頻率為輸入數(shù)據(jù)的函數(shù)。用傳統(tǒng)的方法設計,其設計過程和電路都比較復雜,且設計成 果的可修改性和可移植性都較差?；赩HDL 的數(shù)控分頻器設計,整個過程簡單、快捷,極易修改,可移植性強。他可利用 并行預置數(shù)的加法計數(shù)器和減法計數(shù)器實現(xiàn)...

  標簽： VHDL 數(shù)控 分頻器 修改

  上傳時間： 2014-11-29

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  資源簡介：自己做的VHDL交通燈控制器；分頻器、信號控制器、時鐘模塊；EDA； 通過了仿真、運行。時間可以設置為隨意的兩位數(shù).

  標簽： VHDL EDA 交通燈控制器 分頻器

  上傳時間： 2017-08-10

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  上傳時間： 2014-01-17

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• 74LS294 74LS292分頻器免費下載

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  標簽： 74 LS 294 292

  上傳時間： 2013-12-27

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  上傳時間： 2013-11-03

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  資源簡介：半整數(shù)分頻器電路的VHDL源程序，供大家學習和討論。

  標簽： VHDL 整數(shù) 分頻器 電路

  上傳時間： 2013-12-24

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  資源簡介：用VHDL編寫的8位全加器,數(shù)字分頻器等程序

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  上傳時間： 2013-12-16

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  資源簡介：數(shù)控分頻器設計:對于一個加法計數(shù)器，裝載不同的計數(shù)初始值時，會有不同頻率的溢出輸出信號。計數(shù)器溢出時，輸出‘1’電平，同時溢出時的‘1’電平反饋給計數(shù)器的輸入端作為裝載信號；否則輸出‘0’電平。

  標簽： 數(shù)控 分頻器 加法 計數(shù)器

  上傳時間： 2015-07-16

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  資源簡介：基于VHDL語言描述的一個分頻器，根據(jù)端口值，可作為四分頻，八分頻等分頻器使用。

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  上傳時間： 2013-12-31

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  標簽： windows 8253 32 匯編

  上傳時間： 2013-12-01

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  資源簡介：本文件介紹的是用VerilogHDL語言設計分頻器和32位計數(shù)器.

  標簽： VerilogHDL 語言 分頻器 計數(shù)器

  上傳時間： 2013-12-15

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  資源簡介：本文主要介紹了50％占空比三分頻器的三種設計方法，并給出了圖形設計、VHDL設計、編譯結果和仿真結果。設計中采用EPM7064AETC44-7 CPLD，在QUARTUSⅡ4.2軟件平臺上進行。

  標簽： 三分頻 設計方法

  上傳時間： 2014-01-25

  上傳用戶：凌云御清風

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  上傳時間： 2014-01-12

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  標簽： verilog 編寫 分頻器 測試程序

  上傳時間： 2013-12-17

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  上傳時間： 2013-12-25

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  標簽： 分頻器

  上傳時間： 2013-12-21

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  資源簡介：基于FPGA的分頻器設計,已經(jīng)通過了仿真(VHDL語言編寫)

  標簽： FPGA VHDL 分頻器 仿真

  上傳時間： 2013-12-14

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